基于FPGA的高速LDPC码编码器的设计与实现
丁 宏 杨 帅 指导教师:罗 武
摘要: LDPC码是通信系统中一种性能十分优秀的信道编码。本文针对便于硬件实现的QC_LDPC码进行了编码器设计,采用多路并行、流水线结构、优化关键路径等多种手段,在Altera公司FPGA平台上实现了编码速率高达1.6Gbps的编码器,并使用逻辑分析仪验证了编码器在高速运行下结果的正确性。
Abstract:
Key words :

摘  要:LDPC码" title="LDPC码">LDPC码是通信系统中一种性能十分优秀的信道编码。本文针对便于硬件实现的QC_LDPC码进行了编码器" title="编码器">编码器设计,采用多路并行、流水线结构、优化关键路径等多种手段,在Altera公司" title="Altera公司">Altera公司FPGA" title="FPGA">FPGA平台上实现了编码速率高达1.6Gbps的编码器,并使用逻辑分析仪验证了编码器在高速运行下结果的正确性。

 

关键词:LDPC,高速编码器,FPGA

 

 

基于FPGA的高速LDPC码的设计与实现-北京大学-丁宏.pdf

通知公告
编辑观点
理事会
参考资料
版权声明

凡《网络安全与数据治理》(原《信息技术与网络安全》)录用的文章,如作者没有关于汇编权、翻译权、印刷权及电子版的复制权、信息网络传播权与发行权等版权的特殊声明,即视作该文章署名作者同意将该文章的汇编权、翻译权、印刷权及电子版的复制权、信息网络传播权与发行权授予本刊,本刊有权授权本刊合作数据库、合作媒体等合作伙伴使用。同时,本刊支付的稿酬已包含上述使用的费用,特此声明。

《网络安全与数据治理》(原《信息技术与网络安全》)编辑部