摘 要：在数字信号处理领域，小波变换无论在理论研究还是工程应用方面都具有广泛的价值，因此高性能离散小波变换的FPGA实现架构的研究就显得尤为重要。本文针对db8 (Daubechies 8)小波设计了一个16阶16位的正、反变换系统，用DE2开发板进行了系统验证，在FPGA的逻辑单元资源消耗12%的情况下，正、反变换的最高时钟频率分别达到了217.72MHz、217.58MHz。对比同类文献，本设计在最高处理速度方面具有明显的优势。在此基础上，考虑到通用性的要求，本文还设计了一种小波种类可选、小波阶数可调的通用小波变换FPGA架构，该通用小波正、反变换系统的最高时钟频率分别为114.10 MHz、152.09 MHz。此结构具有通用性强的特点，可高性能实现多种小波变换。设计采用DA(Distributed Arithmetic)算法和LUT(Look-Up Table)技术来实现小波变换中的滤波器，并使用流水线结构以及调用Altera 提供的IP核完成了设计的优化，用MATLAB验证了设计的功能。
关键词：DWT；IDWT；FPGA；Mallat算法；DA算法
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